S3C2440有三种时钟：FCLK HCLK PCLK FCLK: CPU HCLK :内存芯片，网卡等 PCLK :UART，定时器等 设置这三种时钟的方式：晶振通过PLL，达到一个很高的频率FCLK ，然后将FCLK 分频,以达到想要的HCLK PCLK; 下图是S3C2440CPU，系统刚上电时cpu运行的频率FCLK等于晶振OSC的频率,通过PLL设置，FCLK
单片机内部时钟pll到48 arr即 hal的AutoRload Register 这里我配置为499 psc即hal的Prescaler这里我配置为47 输出频率计算办法 那么频率最终就是Fclk/arr+1（1000 000/500=2000hz） 溢出时间Tout=((arr+1)*(psc+1))/Fclk 。单位 us. Fclk单位是Mhz 这里500*48/48=500us;
一、S3C2440上的UART 1.1 串口概述 串口的使用位于S3C2440芯片手册的第11章。S3C2440A 的通用异步收发器（UART）配有3 个独立异步串行I/O端口，每个都可以是基于中断或基于DMA 模式的操作。换句话说，UART 可以通过产生中断或DMA 请求来进行CPU和UART之间的数据传输。 UART 通过使用系统
1. 在STM32中，有五个时钟源，为HSI、HSE、LSI、LSE、PLL： ① HSI是高速内部时钟，RC振荡器，频率为8MHz； ② HSE是高速外部时钟，可接石英/陶瓷谐振器，或者接外部时钟源，频率范围为4MHz~16MHz； ③ LSI是低速内部时钟，RC振荡器，频率为40kHz； ④ LSE是
记录一下时钟相关学习笔记(S3C2440 ARM-CHIP-32bit为例） 问题引入： Q: CPU运行速度很快，但是外设运行的则比较慢，那它们的时钟源怎么匹配呢？ A: 它们有不同的时钟源。 CLOCKS 计算机的心脏，给主板的芯片提供时钟信号，与晶振连接给其他部件提供时钟信号。 WHAT S3C2440有三种
s3c2440裸机编程-时钟编程(二、配置时钟寄存器) 1.2440时钟时序 下图是2440时钟配置时序： 1.上电后，nRESET复位信号拉低，此时cpu还无法取指令工作。 2.nRESET复位信号结束后变为高电平，此时cpu开始工作。此时cpu主频FCLK=osc。 3.此时可以配置PLL，经过lock time后，FCLK倍频成新的时钟。
作者：GWD 时间：2019.7.7 一、课程内容 1、介绍了S3C2440配置时钟的几个寄存器 二、S3C2440_Clock部分分析 1、OVERVIEW部分 分析：S3C2440可以产生FCLK时钟给CPU、HCLK时钟给AHB高速总线、PCLK时钟给APB低速总线设备；还有两个锁相环用于匹配(提升)晶振的时钟频率； 2、FUNCTIONAL
对Figure7-4的说明：上电时，PLL没被启动，FCLK等于外部输入时钟，称为Fin。1 上电几毫秒后，晶振（OSC）输出稳定，FCLK = Fin，nRESET恢复高电平后，CPU开始执行指令。2 设置MPLL，等待Lock Time（使MPLL输出稳定），MPLL稳定输出，CPU工作于新的工作频率（在Lock Time期间，FCLK停震，CPU停止工作）。 具体的配置
FCLK是提供给ARM920T 的时钟。 HCLK 是提供给用于 ARM920T，存储器控制器，中断控制器，LCD 控制器，DMA 和 USB 主机模块的 AHB总线的时钟。 PCLK 是提供给用于外设如WDT，IIS，I2C，PWM 定时器，MMC/SD 接口，ADC，UART，GPIO，RTC 和SPI的 APB 总线的时钟。
