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  • 相位偏转角估计(复数相角计算)---Verilog2020-06-29 22:03:49

    相位偏转角估计(复数相角计算)---Verilog 1 /********************************************************************/ 2 /*模块名称:Estimation_Phase ******/////// 3 /*

  • 数字电路:数据选择器与译码器2020-06-25 18:41:53

    1、本次实验会用到的数据选择器153与译码器138有哪些主要的引脚?其基本功能是什么? 2、请利用8选1 数据选择器74LS151(教材P100)设计全加器。 3、请利用4选1数据选择器74LS152设计全加器。 4、请利用38译码器74LS138设计全加器。 5、下面是38译码器的verilog代码,以及仿真代码

  • DDR2(1):Quartus DDR2 IP 官方例程仿真2020-06-09 18:01:27

      DDR2难度比 SDRAM 复杂,自己写控制器不现实,直接用 IP 核比较靠谱。本篇博客记录一下 QuartusII 13.0 软件下的 DDR2 IP 核的官方例程仿真。   注意事项 1、关闭 Windows 的防火墙和电脑里的各种奇葩电脑管家。 2、以“管理员身份”打开 Quartus II 13.0。 3、所建工程要和 Qua

  • QAM调制---Verilog代码2020-06-06 18:01:28

    QAM调制---Verilog代码 `timescale 1ns / 1ps ////////////////////////////////////////////////////////////////////////////////// // Company: // Engineer: // // Create Date: 2020/05/28 11:41:08 // Design Name: // Module Name: DATA_16QAM_mapper // Project Nam

  • 基于SCCB协议的FPGA实现2020-06-01 21:01:53

    SCCB协议 1、协议内容 SCCB协议常用于vo系列的摄像头的寄存器配置中,是有IIC协议演变而来。本来,本人接触这个协议也是想配置摄像头用于摄像模块。但是,由于配置寄存器实在是太多,而且需要找的资料也比较多,就放弃了,以后有时间再去完成吧。现在先将SCCB协议的设计过程记录下来,方便以后

  • verilog语言入门教程2020-05-27 23:53:28

    转自https://www.cnblogs.com/jian-jia/archive/2019/11/24/11924371.html   module a(b, c, d,...z);//module: 模块头 a:模块名 (b,c,d,...z):端口列表 input b;//输入声明 input wire c;//输入声明线网类型用wire,wire可省略 input wire [7:0] d;//[7:0]:输入总线位宽0~7所以

  • 数据发送模块---基于地址的检测(verilog代码)2020-05-15 22:55:51

    数据发送模块---基于地址的检测(verilog代码) `timescale 1ns / 1ps ////////////////////////////////////////////////////////////////////////////////// // Company: // Engineer: chensimin // // Create Date: 2020/04/24 15:21:43 // Design Name: // Module Name: send

  • 07模块化设计之top_down2020-05-08 22:02:35

    一设计功能:(一)用两个分频模块,实现16分频,且让输入a 和b在16个系统时钟内,相与一次。             (二)模块化设计思想(结构化思维)           拆分,即把一个系统划分成多个功能模块,控制模块,组合模块。然后从功能模块开始,循序渐进一个个设计好,再把所有的模块连

  • Vivado中FFT IP核的使用2020-05-05 11:39:51

    FFT(快速傅里叶变换)作为数字信号处理的核心算法具有重要的研究价值,可应用于傅里叶变换所能涉及的任何领域,如图像处理、音频编码、频谱分析、雷达信号脉冲压缩等数字信号处理领域。FFT的鲜明特征之一是计算离散傅里叶变换(DFT)的高效算法,把计算N点DFT的乘法运算量从N2次降低到N/

  • 计算机组成原理_verilog学习_实验二答案(原创)2020-04-30 10:03:21

    //第1关:多路选择器的设计 1.A 2.BEI //第2关:译码器设计 module decoder3e (n,ena,e); input [2:0] n; input ena; output reg[7:0] e; // 请利用always结构说明语句填写代码,完成3-8译码器功能 /********** Begin *********/ always @(n or ena)

  • [RTL]W1C類型的Register是如何工作的2020-04-19 11:04:00

                        一種W1C類型Register的RTL實現方法          前言:在Design中會用到很多的states寄存器,用來指示Design的工作狀態,而Sofeware可以通過設置其他寄存器來清除掉這些States,這種需求可以用W1C類型(寫1清0,讀取無影響,寫0無影響)的寄存器來實現。  

  • verilog实现异步fifo2020-03-02 18:01:04

    首先要理解fifo的写满和读空,用多出来的一位来扩充地址 使用格雷码判断当,写指针追上读指针时候就是写满,为了方便判断当写满时候即,写地址地最高和次高位与读地址相反其他位相同时就是写满, 当读地址的所有位和写地址的所有位相等就是读空 代码根据图可以轻松得到: 下图是地址计

  • FPGA之数码管动态显示2020-02-06 10:41:43

    实现数码管动态计数,每隔0.1秒计数一次 数码管连接方式不同分为共阴极数码管和共阳极数码管。 数码管引脚: 上图两个com引脚实际是连在一起的,其他引脚的公共端,称为位选,位选的高低电平决定改数码管能否点亮,其他管脚为段选信号,决定数码管上哪个二极管发光。 共阴极数码管连接方

  • 自己动手写CPU_5_5.2 OpenMIPS对数据相关问题的解决措施2020-01-16 20:54:30

    5.2 OpenMIPS对数据相关问题的解决措施 OpenMIPS采用数据前推的方式来解决流水线数据相关问题。如图所示(虚线),将执行阶段的结果、访存阶段的结果推到译码阶段,参与译码阶段选择运算源操作数的过程。 下图给出了实现数据前推对OpenMIPS系统结构的修改,具体为以下两方面:   1. 处于EX

  • 基于FPGA的SPI接口讲解——flash M25P28为例(3)2020-01-11 13:39:44

    flash M25P128读操作时序图设计flash_read模块的书写flash_read测试模块的代码其他模块的代码实验结果结束语 我们本次实验的内容是,对flash读一个字节的数据,系统框图如下: 所用到的软硬件环境为: 硬件:锆石A4plus开发板 软件:quartus II 13.1 从技术手册中我们可以得到如下信息:

  • 基于MIG IP核的DDR3控制器(二)2019-12-29 19:54:28

    上一节中,记录到了ddr控制器的整体架构,在本节中,准备把ddr控制器的各个模块完善一下。 可以看到上一节中介绍了DDR控制器的整体架构,因为这几周事情多,又要课设什么的麻烦,今天抽点时间把这个记录完了,不然以后都忘了DDR该咋去控制了。       从本次实验的整体功能模块可以看出,最终

  • Verilog有符号整型数(signed int)比大小2019-11-07 11:01:30

    本文参考了https://blog.csdn.net/wenxinwukui234/article/details/42119265/ 关于2进制补码的思考和讨论。 ====================================================================================================== 即使在变量声明的时候定义了signed属性, 在Verilog中使用>

  • 带你了解FPGA(4)--Verilog基本语法2019-09-11 11:06:00

    基本语法1. 模块类声明类语法2. 端口声明3. 参数定义4. 信号类型5. 多语句定义6. 比较语句7. 循环语句8. 任务定义9. 连续赋值10. always模块11. 运算操作符12. 赋值符号 1. 模块类声明类语法 module···endmodule 在Verilog中都会出现这个语法,这是一个固定的语法,所有的

  • verilog 数据类型2019-09-05 19:00:24

    数据类型 1、wire和tri: 至于tri其实和wire在用法上是一模一样的,不过有时候,我们需要定义一些会被三态门驱动的硬件连线,用tri来命名会让代码更具有可读性,让人一看就知道这根连线上会出现Z状态,仅此而已! 2、wor与trior:or的含义在里面。 3、reg[3:0]:寄存器类型。 运算符与表达式

  • Glow wire test2019-09-03 17:03:16

    Glow wire test is to test the stability of electrical and electronic products during working. And the hot wire itself is the resistance wire ring with fixed size. When doing test, the wire ring should be heated up to the specified temperature by electrici

  • ardunio平衡小车——使用MPU6050模块2019-08-08 20:04:58

    首先介绍一下mpu6050,反正就是挺好用的,自己百度吧,写多了看也看不懂。 重要的地方讲讲。首先是mpu6050配置 void set_gyro_registers(){   //Setup the MPU-6050   if(eeprom_data[31] == 1){     Wire.beginTransmission(gyro_address);           //Start commu

  • printf系列教程05_SWO打印输出配置,基于ST-LINK Utility『Serial Wire Viewer』2019-07-01 09:24:22

    本文原创作者『strongerHuang』 首发于微信公众号『嵌入式专栏』,同时也更新在我的个人网站:EmbeddedDevelop 标签:printf、 SWD、 SWO、 SWV、 ITM、 JLink-RTT、 ST-Link、 J-Link、 仿真、 重定义、 串口映射   一、写在前面 SWD:Serial Wire Debug,串行线调试 SWO:Serial Wire O

  • [译] QUIC Wire Layout Specification - Frame Types and Formats | QUIC协议标准中文翻译(4) 帧类型和格式2019-06-09 20:53:18

    欢迎访问我的个人网站获取更好的阅读排版体验: [译] QUIC Wire Layout Specification - Frame Types and Formats | QUIC协议标准中文翻译(4) 帧类型和格式 | yoko blog (https://pengrl.com/p/47156/) 目录 Frame Types | 帧类型 STREAM Frame | 流类型帧 ACK Frame | ACK帧 STOP_

  • P2885 [USACO07NOV]电话线Telephone Wire2019-06-07 11:39:22

    题目描述 Farmer John's cows are getting restless about their poor telephone service; they want FJ to replace the old telephone wire with new, more efficient wire. The new wiring will utilize N (2 ≤ N ≤ 100,000) already-installed telephone poles, each wit

  • [译] QUIC Wire Layout Specification - Introduction & Overview | QUIC协议标准中文翻译(1) 简介和概述2019-06-06 22:48:05

    本文同步发布于: https://www.pengrl.com/p/33330/ ,转载请注明出处,谢谢。 目录 Introduction | 简介 Conventions and Definitions | 约定和定义 A QUIC Overview | 概述 Connection Establishment Latency | 连接建立延时 Flexible Congestion Control | 弹性拥塞控制 Stream and

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